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機構 日期 題名 作者
國立交通大學 2014-12-08T15:26:11Z An automatic interconnection rectification technique for SoC design integration Wang, CY; Tung, SW; Jou, JY
國立交通大學 2014-12-08T15:26:11Z An efficient IP-Level power model for complex digital circuits Hsu, CY; Liu, CNJ; Jou, JY
國立交通大學 2014-12-08T15:26:04Z An efficient approach for error diagnosis in HDL design Shi, CH; Jou, JY
國立交通大學 2014-12-08T15:25:57Z RLC effects on worst-case switching pattern for on-chip buses Tu, SW; Jou, JY; Chang, YW
國立交通大學 2014-12-08T15:25:57Z An efficient approach for hierarchical submodule extraction Lin, YW; Jou, JY
國立交通大學 2014-12-08T15:25:57Z An efficient logic extraction algorithm using partitioning and circuit encoding Huang, L; Jiang, TY; Jou, JY; Huang, HL
國立交通大學 2014-12-08T15:25:49Z Verification on port connections Lee, GW; Wang, CY; Huang, JD; Jou, JY
國立交通大學 2014-12-08T15:25:43Z Enhancing sequential depth computation with a branch-and-bound algorithm Yen, CC; Jou, JY
國立交通大學 2014-12-08T15:25:42Z Graph automorphism-based algorithm for determining symmetric inputs Chou, CL; Wang, CY; Lee, GW; Jou, JY
國立交通大學 2014-12-08T15:25:40Z Layout techniques for on-chip interconnect inductance reduction Tu, SW; Jou, JY; Chang, YW

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