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機構	日期	題名	作者
國立交通大學	2014-12-08T15:48:52Z	A physical model for the correlation between holding voltage and holding current in epitaxial CMOS latch-up	Chen, MJ; Lee, HS; Chen, JH; Hou, CS; Lin, CS; Jou, YN
國立交通大學	2014-12-08T15:02:35Z	Back-gate forward bias method for low-voltage CMOS digital circuits	Chen, MJ; Ho, JS; Huang, TH; Yang, CH; Jou, YN; Wu, T

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