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機構	日期	題名	作者
臺大學術典藏	2020-05-04T07:27:45Z	Improving DRAM latency with dynamic asymmetric subarray.	Lu, Shih-Lien;Lin, Ying-Chen;Yang, Chia-Lin; Lu, Shih-Lien; Lin, Ying-Chen; Yang, Chia-Lin; CHIA-LIN YANG
臺大學術典藏	2020-05-04T07:27:45Z	Improving DRAM latency with dynamic asymmetric subarray.	Lu, Shih-Lien;Lin, Ying-Chen;Yang, Chia-Lin; Lu, Shih-Lien; Lin, Ying-Chen; Yang, Chia-Lin; CHIA-LIN YANG

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