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教育部委托研究计画 计画执行:国立台湾大学图书馆
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A queue manager chip for shared buffer ATM switches
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Two systolic architectures for modular multiplication
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2014-12-08T15:44:35Z |
Delay-optimal technology mapping for hard-wired non-homogeneous FPGAs
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Chuang, HH; Jou, JY; Shung, CB |
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