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"wong cheng chi"的相关文件
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| 國立交通大學 |
2014-12-08T15:08:26Z |
A 0.22nJ/b/iter 0.13 mu m turbo decoder chip using inter-block permutation interleaver
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Wong, Cheng-Chi; Tang, Cheng-Hao; Lai, Ming-Wei; Zheng, Yan-Xiu; Lin, Chien-Ching; Chang, Hsie-Chia; Lee, Chen-Yi; Su, Yu-T. |
| 國立交通大學 |
2014-12-08T15:07:28Z |
Turbo Decoder Using Contention-Free Interleaver and Parallel Architecture
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Wong, Cheng-Chi; Lai, Ming-Wei; Lin, Chien-Ching; Chang, Hsie-Chia; Lee, Chen-Yi |
| 國立交通大學 |
2014-12-08T15:06:36Z |
Reconfigurable Turbo Decoder With Parallel Architecture for 3GPP LTE System
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Wong, Cheng-Chi; Chang, Hsie-Chia |
显示项目 11-13 / 13 (共1页)
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每页显示[10|25|50]项目
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