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臺大學術典藏 2018-09-10T08:42:39Z A corner stitching compliant B-tree representation and its applications to analog placement YAO-WEN CHANG; Tsao, H.-F.;Chou, P.-Y.;Huang, S.-L.;Chang, Y.-W.;Lin, M.P.-H.;Chen, D.-P.;Liu, D.; Tsao, H.-F.; Chou, P.-Y.; Huang, S.-L.; Chang, Y.-W.; Lin, M.P.-H.; Chen, D.-P.; Liu, D.
臺大學術典藏 2018-09-10T08:42:38Z Hierarchical placement with layout constraints Lin, M.P.-H.;Chang, Y.-W.; Lin, M.P.-H.; Chang, Y.-W.; YAO-WEN CHANG
臺大學術典藏 2018-09-10T08:42:38Z Heterogeneous B*-trees for analog placement with symmetry and regularity considerations Chou, P.-Y.;Ou, H.-C.;Chang, Y.-W.; Chou, P.-Y.; Ou, H.-C.; Chang, Y.-W.; YAO-WEN CHANG
臺大學術典藏 2018-09-10T08:42:38Z Escape routing for staggered-pin-array PCBs Ho, Y.-K.;Lee, H.-C.;Chang, Y.-W.; Ho, Y.-K.; Lee, H.-C.; Chang, Y.-W.; YAO-WEN CHANG
臺大學術典藏 2018-09-10T08:42:38Z Cross-contamination aware design methodology for pin-constrained digital microfluidic biochips Lin, C.C.-Y.;Chang, Y.-W.; Lin, C.C.-Y.; Chang, Y.-W.; YAO-WEN CHANG
臺大學術典藏 2018-09-10T08:42:38Z An EOS-Free PNP-enhanced cascoded NMOSFET structure for high voltage application Wang, S.-Y.;Chang, Y.-W.;Chen, Y.-Y.;He, C.-W.;Wu, G.-W.;Lu, T.-C.;Chen, K.-C.;Lu, C.-Y.; Wang, S.-Y.; Chang, Y.-W.; Chen, Y.-Y.; He, C.-W.; Wu, G.-W.; Lu, T.-C.; Chen, K.-C.; Lu, C.-Y.; YAO-WEN CHANG
臺大學術典藏 2018-09-10T08:42:37Z Simultaneous functional and timing ECO Chang, H.-Y.;Jiang, I.H.-R.;Chang, Y.-W.; Chang, H.-Y.; Jiang, I.H.-R.; Chang, Y.-W.; YAO-WEN CHANG
臺大學術典藏 2018-09-10T08:42:37Z Routability-driven analytical placement for mixed-size circuit designs Hsu, M.-K.;Chou, S.;Lin, T.-H.;Chang, Y.-W.; Hsu, M.-K.; Chou, S.; Lin, T.-H.; Chang, Y.-W.; YAO-WEN CHANG
臺大學術典藏 2018-09-10T08:42:37Z Pulsed-latch aware placement for timing-integrity optimization Chuang, Y.-L.;Kim, S.;Shin, Y.;Chang, Y.-W.; Chuang, Y.-L.; Kim, S.; Shin, Y.; Chang, Y.-W.; YAO-WEN CHANG
臺大學術典藏 2018-09-10T08:42:37Z Proceedings of the International Symposium on Physical Design: Foreword Chang, Y.-W.;Hu, J.; Chang, Y.-W.; Hu, J.; YAO-WEN CHANG

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