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| 國立交通大學 |
2014-12-13T10:36:37Z |
前瞻設計變更核心技術之開發
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江蕙如; Jiang Iris Hui-Ru |
| 國立交通大學 |
2014-12-13T10:31:03Z |
平行運算電子設計自動化技術研究---子計畫四：設計變更平行最佳化( III )
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江蕙如; Jiang Iris Hui-Ru |
| 國立交通大學 |
2014-12-13T10:30:52Z |
單晶片系統驗證之核心技術開發-子計畫四：單晶片系統設計流程之實體驗證(I)
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江蕙如; Jiang Iris Hui-Ru |
| 國立交通大學 |
2014-12-13T10:29:17Z |
單晶片系統驗證之核心技術開發---子計畫四：單晶片系統設計流程之實體驗證(II)
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江蕙如; Jiang Iris Hui-Ru |
| 國立交通大學 |
2014-12-12T02:43:21Z |
使用動態邊界與元件合併移除時序分析中共同路徑悲觀性之研究
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張育維; Chang, Yu-Wei; 江蕙如; Jiang, Iris Hui-Ru |
| 國立交通大學 |
2014-12-12T02:43:17Z |
使用定位同步技術之非同步電路自動化流程設計
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蔡廷南; Tsai, Ting-Nan; 江蕙如; Jiang, Iris Hui-Ru |
| 國立交通大學 |
2014-12-12T02:32:19Z |
基於多學習機器之製程熱點檢測
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林耕禾; Lin, Geng-He; 江蕙如; Jiang, Iris Hui-Ru |
| 國立交通大學 |
2014-12-12T01:37:47Z |
適用於三維積體電路之線性規劃
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梅宗菀; Mei, Tsung-Wan; 江蕙如; Jiang, Iris Hui-Ru |
| 國立交通大學 |
2014-12-08T15:47:58Z |
Configurable Rectilinear Steiner Tree Construction for SoC and Nano Technologies
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Jiang, Iris Hui-Ru; Yu, Yen-Ting |
| 國立交通大學 |
2014-12-08T15:47:56Z |
Power-State-Aware Buffered Tree Construction
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Jiang, Iris Hui-Ru; Wu, Ming-Hua |
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