臺灣學術機構典藏系統 (Taiwan Academic Institutional Repository, TAIR)

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机构	日期	题名	作者
國立交通大學	2015-07-21T08:29:25Z	A Cache Hierarchy Aware Thread Mapping Methodology for GPGPUs	Lai, Bo-Cheng Charles; Kuo, Hsien-Kai; Jou, Jing-Yang
國立交通大學	2014-12-16T06:15:56Z	Fine-grained bandwidth control arbiter and the method thereof	Huang, Juinn-Dar; Lin, Bu-Ching; Lee, Geeng-Wei; Jou, Jing-Yang
國立交通大學	2014-12-16T06:15:24Z	DELAY OPTIMAL COMPRESSOR TREE SYNTHESIS FOR LUT-BASED FPGAS	HUANG Juinn-Dar; Lu Jhih-Hong; Lin Bu-Ching; Jou Jing-Yang
國立交通大學	2014-12-13T10:51:53Z	單晶片系統驗證之核心技術開發---子計畫二：針對單晶片系統界面協定之驗證(III)	周景揚; JOU JING-YANG
國立交通大學	2014-12-13T10:51:11Z	後次微米時代新興電子設計自動化技術之研究---子計畫三：角落錯誤之矽除錯(I)	周景揚; JOU JING-YANG
國立交通大學	2014-12-13T10:51:09Z	多媒體系統晶片設計技術研究---子計畫五：系統晶片上系統驗證之研究	周景揚; JOU JING-YANG
國立交通大學	2014-12-13T10:51:03Z	後次微米時代新興電子設計自動化技術之研究---總計畫(I)	周景揚; JOU JING-YANG
國立交通大學	2014-12-13T10:51:03Z	使用60GHz之室內十億級位元傳輸率之無線基頻傳收機---子計畫三：針對通訊數位訊號處理器之電子系統層級驗証與合成環境(I)	周景揚; JOU JING-YANG
國立交通大學	2014-12-13T10:51:01Z	單晶片系統之電腦輔助設計研究(II)	周景揚; JOU JING-YANG
國立交通大學	2014-12-13T10:50:03Z	多媒體系統晶片設計技術之究---子計畫V：系統晶片上系統驗證之研究(II)	周景揚; JOU JING-YANG

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