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教育部委託研究計畫 計畫執行:國立臺灣大學圖書館
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| 國立臺灣大學 |
1994-05 |
The complementary relationship of interprocedural register allocation and inlining
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Lai, Feipei; Chao, Yung-Kuang |
| 國立彰化師範大學 |
1994-03 |
A Superscalar Micro-architecture Supporting Aggressive Instruction Scheduling
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Chang, Meng-chou; Lai, Feipei |
| 國立臺灣大學 |
1994-01 |
A pipeline bubbles reduction technique for the Monsoon dataflow architecture
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Lai, Feipei; Tsai, Fong-Chou |
| 國立臺灣大學 |
1993-10 |
Arden - Architecture Development Environment
|
Lai, Feipei; Hwang, Shu-Lin; Chen, Tzer-Shyong; Hsieh, Chia-Rung |
| 國立彰化師範大學 |
1992-12 |
Exploiting Instruction-Level Parallelism with the Conjugate Register File Scheme
|
Chang, Meng-chou; Lai, Feipei; Shang, Rung-ji |
| 淡江大學 |
1992-11-11 |
Estimating register cost using spots
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Lai, Feipei; Yeh, Chia-cheng; 李鴻璋; Lee, Hung-chang |
| 國立臺灣大學 |
1992-11 |
Estimating register cost using spots
|
Lai, Feipei; Yeh, Chia-Cheng; Lee, Hung-Chang |
| 淡江大學 |
1992-09-01 |
Register allocation via dynamically updated information
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賴飛羆; Lai, Feipei; 葉家誠; Yeh, Chia-cheng; 李鴻璋; Lee, Hung-chang |
| 淡江大學 |
1992-09-01 |
動態資訊式暫存器配置法
|
賴飛羆; Lai, Feipei; 葉家誠; Yeh, Chia-cheng; 李鴻璋; Lee, Hung-chang |
| 國立彰化師範大學 |
1992-05 |
Enhancing Boosting with Semantic Register in a Superscalar Processor
|
Lai, Feipei; Chang, Meng-chou |
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