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机构 日期 题名 作者
中華大學 2006 VLSI Implementation of Memory-Efficiency Multiplierless DCT and IDCT Processors 謝曜式; Shieh, Yaw-Shih
國立中山大學 1995-12 VLSI implementation of multi-valued exponential bidirectional associative memory using current-mode circuits C.C. Wang;Y.C. Chen
中華大學 2005 VLSI Implementation of Pipelined Architectures for 2-D Discrete Wavelet Transform and Its Inversion 宋志雲; Sung, Tze-Yun
中華大學 2005 VLSI Implementation of Pipelined Architectures for 2-D Discrete Wavelet Transform and Its Inversion 謝曜式; Shieh, Yaw-Shih
中華大學 2005 VLSI Implementation of Pipelined Architectures for 2-D Discrete Wavelet Transform and Its Inversion 林國珍; Lin, Kuo-Jen
臺大學術典藏 2018-09-10T09:48:39Z VLSI implementation of real-time motion compensated beamforming in synthetic transmit aperture imaging Ho, K.-Y.;Chen, Y.-H.;Zhan, C.-Z.;y Wu, A.-Y.; Ho, K.-Y.; Chen, Y.-H.; Zhan, C.-Z.; y Wu, A.-Y.; AN-YEU(ANDY) WU
臺大學術典藏 2018-09-10T04:07:51Z VLSI implementation of shape-adaptive discrete wavelet transform Tseng, P.-C.; Huang, C.-T.; Chen, L.-G.; LIANG-GEE CHEN
臺大學術典藏 2018-09-10T06:54:39Z VLSI implementation of the motion estimator with two-dimensional data-reuse Lai, Y.-K.; Lai, Y.-L.; Liu, Y.-C.; Chen, L.-G.; LIANG-GEE CHEN
國立中山大學 1998-02 VLSI Implementation of the Quadratic-Spline W-Transform for Multi-resolution Image Processing Shen-Fu Hsiao
國立聯合大學 2004 VLSI Implementation of the Universal 2-D CAT/ICAT System (EI) 陳榮堅, 賴瑞麟
國立臺灣大學 1999-06 VLSI Implementation of Timing Recovery and Carrier Recovery for QAM/VSB Dual Mode Shyh-Jye; Kua, G. H.; Shiue, Muh-Tian; Heh, Jung-Yu; 汪重光; Shyh-Jye; Kua, G. H.; Shiue, Muh-Tian; Heh, Jung-Yu; Wang, C. K.
臺大學術典藏 2018-09-10T06:54:39Z VLSI implementation of visual block pattern truncation coding Liu, Y.-C.; Lai, Y.-K.; Tsai, T.-H.; Wu, P.-C.; Chen, L.-G.; LIANG-GEE CHEN
國立中山大學 1994-08 VLSI Implementations of an Error-Correcting Encoder/Decoder Shen-Fu Hsiao
元智大學 2017-07-02 VLSI implementations of parallel dual-mode MAP decoding for iterative detection and decoding receiver Ching-Wen Hsieh; Cheng-Hung Lin
國立中山大學 1997-12 VLSI implemnetation of a word-slice pipelined maximum selector for priority queues C.C. Wang;G.C. Lin
國立交通大學 2014-12-08T15:04:36Z VLSI NEUROPROCESSORS FOR VIDEO MOTION DETECTION LEE, JC; SHEU, BJ; FANG, WC; CHELLAPPA, R
臺大學術典藏 2018-09-10T07:44:18Z VLSI Process Control RUEY-SHAN GUO;K. Wong;A. Hu;S. Ha;E. Sachs; RUEY-SHAN GUO; K. Wong; A. Hu; S. Ha; E. Sachs; RUEY-SHAN GUO
中華大學 2009 VLSI Reconfigurable Architecture for 9/7-5/3 Lifting-Based Discrete Wavelet Transform 宋志雲; Sung, Tze-Yun
臺大學術典藏 2021-12-14T23:12:45Z VLSI Structure-aware Placement for Convolutional Neural Network Accelerator Units Chou, Yun; Hsu, Jhih Wei; YAO-WEN CHANG; Chen, Tung Chieh
國立交通大學 2014-12-16T08:14:56Z VLSI technology Sze, S M
臺大學術典藏 2018-09-10T06:03:19Z VLSI Test Principles and Architectures CHIEN-MO LI; et. al.; Wen; Wu; Wang
南台科技大學 2005-05 VLSI 實現低複雜度MPEG-4 Simple Profile 編碼系統於嵌入式處理器之SoC 平台 許雲淳; 陳順智; 陳培殷
大葉大學 2007-01-30 VLSI 測試技術之研究 陳建基, 鍾翼能
南台科技大學 1999 VLSI 設計流程整合實務 王立洋; 唐經洲
國立交通大學 2014-12-12T02:04:46Z VLSI 陣列編譯器之設計與實現 黃柏川; Huang, Bo-Chuan; 任建葳; Ren, Jian-Wei

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