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教育部委託研究計畫 計畫執行:國立臺灣大學圖書館
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| 國立交通大學 |
2014-12-08T15:34:49Z |
A 147 GHz Fully Differential D-Band Amplifier Design in 65 nm CMOS
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Li, Chun-Hsing; Lai, Chih-Wei; Kuo, Chien-Nan |
| 臺大學術典藏 |
2018-09-10T03:29:20Z |
A 14b 20MSample/s CMOS pipelined ADC
|
Chen, H.-S.; Bacrania, K.; Song, B.-S.; HSIN-SHU CHEN |
| 國立臺灣大學 |
2001 |
A 14b 20MSamples/s CMOS Pipelined ADC
|
Chen, Hsin-Shu; Song, Bang-Sup; Bacrania, Kantilal |
| 臺大學術典藏 |
2018-09-10T07:08:37Z |
A 15-20GHz delay-locked loop in 90nm CMOS technology
|
Jung-Yu Chang;Chi-Nan Chuang;Shen-Iuan Liu; Jung-Yu Chang; Chi-Nan Chuang; Shen-Iuan Liu; SHEN-IUAN LIU |
| 臺大學術典藏 |
2020-06-04T07:54:06Z |
A 15-50 GHz broadband resistive FET ring mixer using 0.18-μm CMOS technology
|
Chen, J.-H.;Kuo, C.-C.;Hsin, Y.-M.;Wang, H.; Chen, J.-H.; Kuo, C.-C.; Hsin, Y.-M.; Wang, H.; HUEI WANG |
| 臺大學術典藏 |
2018-09-10T04:14:59Z |
A 15-80GHz MMIC SPDT switch using traveling wave concept
|
W. H. Tu; P. Y. Chen; K. Y. Lin; H. Wang; R. B. Wu; S. S. Lu; RUEY-BEEI WU |
| 國立交通大學 |
2014-12-08T15:19:12Z |
A 15-b 40-MS/s CMOS pipelined analog-to-digital converter with digital background calibration
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Liu, HC; Lee, ZM; Wu, JT |
| 國立成功大學 |
2019 |
A 15-bit 20 MS/s SHA-Less Pipelined ADC Achieving 73.7 dB SNDR with averaging correlated level shifting technique
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Wang, J.-C.;Hung, T.-C.;Kuo, T.-H. |
| 國立交通大學 |
2014-12-08T15:18:11Z |
A 15-bit 40-MS/s CMOS pipelined analog-to-digital converter with digital background calibration (vol 40, pg 1047, 2005)
|
Liu, HC; Lee, ZM; Wu, JT |
| 臺大學術典藏 |
2021-03-12T08:41:05Z |
A 15-Gb/s 2:1 multiplexer in 0.18-μm CMOS
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JUN-CHAU CHIEN; 簡俊超; JUN-CHAU CHIEN |
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